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输出延迟
set_output_delay命令指定输出端口相对于设计接口处的时钟边缘。
当考虑应用板时,此延迟表示以下各项之间的相位差:
1.数据从FPGA的输出封装引脚通过板传播到另一个设备,以及
2.相对基准板时钟。
输出延迟值可以是正的…
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